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跟着CDMA扩频本领在民用挪动通讯里的深刻运用和连接浸透,以及在卫星的深空通讯、兵戈制导、GPS定位体例等主力军事通讯的需要下,扩频通讯本领表露出日益宏大的人命力。暂时扩频接受机的兴盛目标是高动静化和软硬件化,诉求接受机具备接受旗号动静范畴大、信噪比低、摆设精巧等特性。伴跟着可编制程序论理器件密度、范围和速率的赶快延长,FPGA(当场可编纂门阵列)在本能、本钱、精巧性和功耗等上面表露了势均力敌的上风,鉴于FPGA的旗号处置器已被普遍运用于百般数字旗号处置范围。正文恰是在这种后台下,提出了以FPGA为中心实行一种高动静直扩通讯数字中频接受机,而且已实行了接受机原型机的研制处事,到达了安排目的舆论中阐明了一种具备快捕功效的高动静直扩数字中频接受机算法安排计划。该计划在通路上运用FPGA通路实行模块化安排,在本领大将正交采集样品器和零本振数字混频相贯串举行下变频,并鉴于配合滤波器、AFC 频次盯梢,实行伪码赶快捕捉、解扩及载波的赶快盯梢。十足算法经过硬件刻画谈话(HDL)实行,参数精巧树立,具备明显的“软接受机”特性。
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