免费论文：某型涡轴发效果电子遏制器BIT安排接洽

跟着微电子和计划本领的兴盛，宇航发效果的电子遏制器正变得搀杂化、归纳化、袖珍化和高本能，所以，其妨碍检验和测定难度增大，动作电子体例和摆设尝试兴盛的新目标和要害本领的机内尝试(BIT)本领，为普及宇航发效果遏制体例的真实性和可保护性供给了新的处置道路。正文在领会宇航发效果电子遏制器的通路构造和特性的普通上，创造了典范通路模块的妨碍形式，并按照BIT安排规则和某型涡轴发效果电子遏制器的个性，对电子遏制器的输出通道、输入通道、传感器、实行组织和通信等典范通路模块举行了精细的BIT安排，体例地提出了各模块的BIT算法，并将 BIT 尝试本领在鉴于 DSP 的宇航发效果电子遏制器道理原型机长进行了工程实行。为了考证电子遏制器的 BIT 检验和测定本领，提出了面向 FADEC 体例的BIT妨碍检验和测定安装的安排思维。BIT妨碍检验和测定安装囊括鉴于ARINC 429总线的检验和测定安装和用来妨碍消息处置的 PC 计划机，它具备妨碍注入、 BIT 检验和测定截止接收和消息处置本领。经过鉴于ARINC 429总线BIT妨碍检验和测定安装对具备BIT功效的电子遏制器道理原型机举行了妨碍检验和测定试验，考证了电子遏制器的 BIT 妨碍检验和测定本能，同声证明该BIT妨碍检验和测定安装是某型涡轴发效果电子遏制器运用和保护的灵验东西。

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