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集成通路仍旧加入片上体例(SoC)阶段。片上体例须要在单个硅片上同声实行模仿通路和数字通路,安排鉴于规范CMOS工艺的高本能模数变换器,不妨灵验普及所有体例的集成度,减小体例体积,具备特殊要害的运用价格。 正文对准毫米波雷达接受机前者旗号特性,商量到后端旗号处置对速率和精度的诉求,安排了速率快、精度高、功耗和表面积对立较小的清流线模数变换通路。按照本课题安排需要,领会了清流线构造处事道理,创造了1.5位/级体例构造,简化了体例搀杂度,贬低了对演算夸大器的本能诉求。通路安排中沿用矫正的库容翻转型采集样品维持通路,该构造具备较大的反应系数,库容和电门的数目较少,实行了表面积小、噪声低、速率快等便宜;电门库容通路局部,领会了库容通路的噪声,计划了采集样品电门的导回电阻、电荷注入和时钟馈通对通路非线性的感化,实行了高线性度栅压自举电门的安排和调节和测试;在演算夸大器安排进程中,按照通路安排表面,领会了演算夸大器增值、变换速度和带延期制,沿用矫正的增值普及构造,调节和测试优化运放本能参数,实行了主运放和扶助运放的安排。沿用数字校准本领,普及了体例对级间缺点的冗余度,安排的动静比拟器失调电压满意体例本能诉求。接洽截止表白:有理安置通路时序,运用底极板采集样品本领的采集样品维持通路,不妨透彻实行采集样品功效,满意体例精度诉求;安排的栅压自举电门保护了采集样品电门栅源电压的恒定,普及了采集样品电门的线性度;安排的演算夸大器,具备较高的直流电增值(达110 dB)和单元增值带宽(达524.6MHz);减少的钳位晶体管,普及了运放的变换速度,实足满意前者采集样品维持通路对运放速率的诉求;数字校准本领的运用,简化了比拟器的安排难度,灵验减小了比拟器功耗。体例本能仿真表白,清流线构造处事宁静,不妨精确精确的实行输出旗号的模数变换,具备较高的线性度,无杂散动静范畴(SFDR)达78.36 dB。
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