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本舆论的目的是安排高动静接受机长周期测距码的直捕模块,实行径直捕捉长周期测距码而不需借助短周期测距码(C码)的扶助,以普及导航体例在搏斗情况下的对立本领。正文重要接洽鉴于FPGA的P码捕捉本领,接洽实质重要囊括:1.接洽接受机的基础构成局部,控制保守的P码捕捉本领。贯串P码周期长的特性,中心控制了两种典范本领:鉴于FFT的码相位并行探求本领和配合滤波器与FFT相贯串的本领,并领会了前者不符合高动静接受机捕捉长码的因为。2.为了缩小硬件资源耗费,实行赶快捕捉,正文经过以次两种本领来实行。其一为对中频数据举行分时处置,缩小体例对FPGA资源的耗费。另一方规则是在检验和测定本领运用鉴于多普勒积累的捕捉本领,对首次捕捉的载波多普勒举行估量,以缩小多普勒对后续处置的感化。3. 实行了鉴于FPGA的配合滤波器和FFT相贯串的本领,仿真截止和尝试截止均表白在实行P码捕捉的普通上灵验的贬低了硬件资源.并给出了鉴于FPGA的总体安排框图,子模块的分别和简直构造,处事过程,时序安置之类.
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