免费论文摘要：鉴于NOC片上钩络多核构造的考证平台的安排与实行

　　集成通路本领在往日的几十年中获得了飞快的兴盛，在简单芯片上可集成的晶体管数量按照着摩尔定理连接减少，片上通讯体制也体验了从点对点到总线构造的变化。然而在本质的操纵中，总线构造也表露出了十分多的本领题目。跟着片上器件数手段进一步减少，总线构造仍旧不许独当一面，为了使各元件之间更好的通讯，芯片安排者须要探求一种新的构造来处置片上器件互连的题目。 　　       片上钩络(Network on Chip, NoC)是连年来提出的一种片上体例(System on Chip, SoC)通讯瓶颈处置计划。与计划机搜集各别，NoC安排中除去要商量搜集本能外还要商量VLSI实行表面积开支及功耗。多核构造是感化NoC本能，表面积，功耗的要害成分。所以，多核构造安排变成NoC中的一项要害本领。 　　　        正文开始阐明了NoC的基础观念，引见了NoC的体制构造、通信和议，以及实行NoC的要害本领。并精细地领会归纳了片上体例的共享总线构造和片上钩络各自的优缺陷，指出片上钩络优于片上体例的场合，以及各自实用的本质情景和范围。NoC原形考证是为了在仿真领会的普通上更精确地评价NoC的本能，以更好的引导安排。正文以Xilinx Virtex-4系列FPGA为平台，以Verilog HDL，Xilinx ISE等为开拓东西，实行了鉴于2D 多核构造的NoC原形安排与考证。

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